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该器件内置一个低噪声、宽带宽、差分采样保持放大器(T/H)，可处理最高达3.5 MHz的输入频率。 外部基准电压通过VREF引脚输入，可在100 mV至3.5 V范围内变化，具体取决于电源和应用。 基准电压值决定器件的共模电压范围。 利用这一真差分输入结构和可变基准电压输入，用户可以选择各种输入范围和偏置点。

转换过程和数据采集通过CS与串行时钟进行控制，从而为器件与微处理器或DSP接口创造了条件。 输入信号在CS的下降沿进行采样，而转换同时在此处启动。

该器件采用SAR架构，确保无流水线延迟。

AD7452采用先进的设计技术，可在高吞吐量的情况下实现较低的功耗。