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TLK6002

双通道470-Mbps到6.25-Gbps多速率收发器

TLK6002产品信息:

TLK6002是多千兆收发器组合的成员之一,用于超高速双向点对点数据传输系统。它是专门为基站RRH(远程无线电头)应用,但也可以用于其他高速应用。TLK6002支持0.470 Gbps到6.25 Gbps的串行接口速度。速率支持包括所有的CPRI和OBSAI速率(0.6144/0.768/1.2288/1.536/2.4576/3.072/4.9152/6.144 Gbps)使用单一的固定参考时钟频率(122.88 MHz或153.6 MHz)。

TLK6002 20位并行接口采用1.5V或1.8V HSTL单端格式。20位接口允许并行侧的低速信号,因此可以在系统设计中使用低成本的FPGA。并行接口可以被编程为SDR (Single Data Rate)或DDR (Double Data Rate)模式。线路速率可设置为full(≤6.25Gbps)、half(≤3.75Gbps)、quarter(≤1.88Gbps)或eighth(≤0.94Gbps)。可以使用设备输入或软件控制寄存器设置线路速率。

TLK6002作为物理层接口设备进行并行到串行、串行到并行的数据转换和时钟提取。串口收发接口的最大串行数据速率为6.25 Gbps。

TLK6002在其并行收发数据总线上接受单端HSTL信号。如果内部的8B/10B编码和解码被启用,TDA/B_[19:0]被TXCLK_A/B锁存并发送到内部的8B/10B编码器,在那里产生的编码字被序列化,并使用从SERDES参考时钟派生的线路时钟以所需的线路速率差分传输。如果内部编码和解码被禁用,TDA/B_[19:0]被定义为20位的数据被序列化,并按照期望的线路速率不加修改地传输。

接收方向对输入串行数据执行串行到并行转换,将产生的20位并行数据同步到恢复的字节时钟(RXCLK_A/B)。可选解码接收数据在RDA/B_[19:0]输出信号上可用。

串行发射机和接收机采用差分电流模式逻辑(CML)与集成终端电阻实现。

TLK6002提供两个本地(并行侧)和两个远程(串行侧)环回模式,用于自检和系统诊断目的。

TLK6002具有集成的LOS (loss of signal)检测功能,在串行输入信号没有足够的电压幅值(≤75 mV(dfpp))的情况下进行检测。注意,当接收数据路径数据丢失时(寄存器位6.6),输入信号必须≥150mv (dfpp)。

TLK6002数据手册:

TLK6002引脚功能、电路图:

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