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意法半导体HSP051-2W3Y 2-line ESD Array的介绍、特性、及应用

来源：HQBUY 发布时间：2021-06-03

摘要： HSP051-2W3Y 2-line ESD阵列是为抑制高速差分线路的静电放电(ESD)而设计的。HSP051-2W3Y提供极低的电容变化，确保极低的影响信号倾斜。封装在紧凑，符合RoHS标准的SOT323-3L封装中，该ESD阵列符合AE...

HSP051-2W3Y 2-line ESD阵列是为抑制高速差分线路的静电放电(ESD)而设计的。HSP051-2W3Y提供极低的电容变化，确保极低的影响信号倾斜。封装在紧凑，符合RoHS标准的SOT323-3L封装中，该ESD阵列符合AEC-Q101的要求，可用于汽车应用。

规范

流贯路由以保持信号完整性
超大带宽:3GHz
超低电容:0.7pF
脉冲峰值功耗(8/20µ年代):20 w
峰值脉冲电流(8/20µs)(测试):1.8
存储温度范围:-65℃~ +150℃
工作结温度范围(Tj): -40°C至+150°C
10秒(TL)焊接期间铅的最高温度:260℃
扩展工作结温度范围:-40°C至150°C

AEC-Q101合格
符合ISO 10605 - C = 150 pf, R = 330欧姆超过4级
- ±12 kv(接触放电)
- ±15千伏(排气)
符合ISO 10605 - C = 330 pf, R = 330欧姆
- ±8kv(接触放电)
- ±12kv(空气放电)
通过无铅认证
封装:SOT323-3L (Jedec TO-236)

应用程序

汽车dataline ESD保护
CAN、CAN- fd和LIN接口的ESD保护
APIX
LVDS和数字视频接口

以太网
BroadR-Reach
USB 2.0和USB 3.0
高速通信总线

包信息

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