摘要: 本应用说明包含摩托罗拉MC68360处理器与DS2141Q或DS2143Q达拉斯半导体T1或E1帧的接口所需的信息。应用说明包括地址和数据处理器总线以及通信串行总线的接口。MC68360的处理器总线与DS2141Q或DS2143Q的接口很简单,地址和数据线的映射如图所示。
本应用说明包含摩托罗拉MC68360处理器与DS2141Q或DS2143Q达拉斯半导体T1或E1帧的接口所需的信息。应用说明包括地址和数据处理器总线以及通信串行总线的接口。MC68360的处理器总线与DS2141Q或DS2143Q的接口很简单,地址和数据线的映射如图所示。根据应用的不同,可能需要添加外部逻辑来锁存地址和数据引脚隔离处理器总线上的其他外设。MC68360包含一个通信处理器模块,该模块包含四个串行通信控制器和两个串行管理控制器。这六个端口中的任何一个都可以映射到MC68360时隙分配器中,为DS2141Q或DS2143Q提供两个时分多路复用总线。MC68360的通信串行总线引脚和时钟名称和描述如图所示,便于参考。示例电路图是在客户端设备中使用的循环计时应用程序,其中恢复的时钟用作传输时钟。应用笔记的目的是为设计人员提供足够的信息来完成基本的原理图。
DS21Q41或DS21Q43与摩托罗拉MC68MH360 (QUICC32)之间的互连如图1所示。MC68MH360可以配置为HDLC控制器,实现DS0通道和FDL或E1 Sa位的LAPD等协议。QUICC32的scc和smc的任何组合都可以通过内部时隙分配器处理到一个或两个时分复用信道,TDM A和TDM B。在如图所示的配置中,TDM信道A用于时隙0-23 (T1)或0-31 (E1), TDM信道B用于FDL (T1)或Sa位(E1)。详细信息请参见MC68MH360 Quad集成通信控制器用户手册。
图1所示 Quad帧- quic32互连。
FDL上的HDLC既可以通过TDM CHANNEL B实现,也可以通过主机处理器(CPU32内部到QUICC32)的端口实现。
其它影响设备运行的信号未显示。
示例电路的输出模式为RSYNC。
其它影响设备运行的信号未显示。
使用SI模式寄存器:
设置发送和接收帧同步延迟(0-3时钟)来掩盖T1应用中的f位。DS21Q41的RFSDA = 1, DS21Q43的RFSDA = 0。
设置时钟沿,发射在上升沿,接收在下降沿。Cea = ceb = 0。
在上面的例子中,TDM信道A有一个通用的发送/接收时钟和同步。Ctra = 1。
使用时隙分配器忽略DS21Q43的时隙0。
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