摘要: 具有集成的Arm Cortex-A55运行高达1.2GHz和双sharc + DSP核心架构。
Analog Devices公司ADSP-SC598 Dual-SHARC+ 数字信号处理器(dsp)采用集成的Arm Cortex-A55,运行频率高达1.2GHz。A55处理器具有FPU和Neon DSP扩展,可处理额外的实时处理任务,并管理用于连接音频应用中时间关键数据的外设。这些接口包括千兆以太网、USB高速、CAN FD和各种其他连接选项,以实现灵活和简化的系统设计。
ADSP-SC598 SHARC处理器采用Analog Devices, Inc.的超级哈佛架构。这些32位/40位/64位浮点处理器针对高性能音频/浮点应用进行了优化,具有大型片上静态随机存取存储器(SRAM),多个消除输入/输出(I/O)瓶颈的内部总线以及创新的数字音频接口(DAI)。SHARC+核心包括缓存增强和分支预测,同时保持指令集与以前的SHARC产品的兼容性。
通过集成一组丰富的行业领先的系统外设和内存,SHARC+处理器是需要类似于精简指令集计算(RISC)的可编程性、多媒体支持和领先的信号处理的应用程序的首选平台。这些应用包括需要高浮点性能的汽车、专业音频和基于工业的应用。
SHARC+核心基础设施
核心时钟频率最高800MHz或1GHz
2x 640KB片上级1 (L1) SRAM内存(带奇偶校验)提高低延迟性能
32位、40位和64位浮点支持
32位不动点
字节、短字、字和长字寻址
Arm核心架构
1.2GHz Arm Cortex-A55(带Neon/FPU)
32kByte/32kByte L1 instr。/数据缓存
256kByte二级缓存
内存
带有ECC保护的2048KB片上2级(L2) SRAM -在许多用例中无需外部存储器
L3 (Level 3)接口,针对低系统功耗进行优化,提供16位DDR3接口(支持1.35V的DDR3L器件)
16位DDR/DDR3L内存控制器,支持1.35V DDR3L
高级硬件加速器
增强的FIR/IIR卸载引擎以核心时钟频率运行,以增加处理能力
安全加密引擎与OTP
强大的DMA系统
数字音频接口(DAI)
8个全SPORT接口,支持TDM和I2S模式
2个S/PDIF Rx/Tx, 8个ASRC对
8倍精度时钟发生器
2个4通道PDM麦克风输入
40 x缓冲区
其他外设连接/接口
1x eMSI (SDIO/eMMC)
2个四SPI, 1个八进制SPI
大联盟3 / 6-pin
6x I(2)C, 3x UARTs
2x link接口
16x通用定时器,1x通用计数器
3x看门狗定时器
ePPI
USB 2.0 HS OTG控制器
10/100 EMAC
10/100/1000 EMAC带AVB和1588
2x CAN FD
8-ch 12位内务ADC
135个GPIO引脚,40个DAI引脚
热传感器
17mm × 17mm (0.8mm节距)400球CSP_BGA封装
安全与保护
加密硬件加速器
快速安全启动与IP保护
增强的FIR和IIR加速器运行高达1GHz
AEC-Q100符合汽车应用要求
汽车
音频放大器
单位负责人
非国大/共和党全国委员会
后座娱乐
数字驾驶舱
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