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详解74ls138译码器芯片的引脚图及功能、工作原理、作用、全加器/全减器等应用电路图、及真值表等

来源:华强商城 发布时间:2021-12-02

摘要: 在本文中小编将为大家详细介绍74ls138译码器芯片的引脚图及功能、工作原理、作用、内部结构电路图、应用电路图(74ls138全加器电路图、全减器电路图、三人表决器电路图、抢答器及实现逻辑函数电路图)、逻辑功能真值表、电气参数及动态特性等。希望能帮助大家更好认识74ls138芯片。

在本文中小编将为大家详细介绍74ls138译码器芯片的引脚图及功能、工作原理、作用、内部结构电路图、应用电路图(74ls138全加器电路图、全减器电路图、三人表决器电路图、抢答器及实现逻辑函数电路图)、逻辑功能真值表、电气参数及动态特性等。希望能帮助大家更好认识74ls138芯片。

74ls138译码器芯片的引脚图及功能


74ls138芯片的引脚图:

74ls138芯片的引脚图

74ls138芯片的引脚功能:

A0~A2:地址输入端

STA(E1):选通端

/STB(/E2)、/STC(/E3):选通端(低电平有效)

/Y0~/Y7:输出端(低电平有效)

VCC:电源正

GND:地

A0~A2对应Y0——Y7;A0,A1,A2以二进制形式输入,然后转换成十进制,对应相应Y的序号输出低电平,其他均为高电平;


译码器芯片74ls138的工作原理


74LS138为3线-8线译码器,共有 54/74S138和 54/74LS138两种线路结构型式,其工作原理如下:

①当一个选通端(E1)为高电平,另两个选通端((/E2))和(/E3))为低电平时,可将地址端(A0、A1、A2)的二进制编码在Y0至Y7对应的输出端以低电平译出。(即输出为Y0至Y7的非)比如:A2A1A0=110时,则Y6输出端输出低电平信号。

②利用 E1、E2和E3可级联扩展成 24 线译码器;若外接一个反相器还可级联扩展成 32 线译码器。

③若将选通端中的一个作为数据输入端时,74LS138还可作数据分配器。

④可用在8086的译码电路中,扩展内存。


74ls138芯片的作用是什么?


74LS138芯片的作用是:

利用 G1、/(G2A)和/(G2B)可级联扩展成 24 线译码器;若外接一个反

相器还可级联扩展成 32 线译码器。

若将选通端中的一个作为数据输入端时,74LS138还可作数据分配器


译码器74ls138的内部结构电路图


译码器74ls138的内部结构电路图



74ls138芯片的应用电路图实例


74ls138全加器电路图


  全加器有3个输入端:a,b,ci;有2个输出端:s,co.与3-8译码器比较,3-8译码器有3个数据输入端:A,B,C;3个使能端;8个输出端,OUT(0-7)。这里可以把3-8译码器的3个数据输入端当做全加器的3个输入端,即3-8译码器的输入A、B、C分别对应全加器的输入a,b,ci;将3-8译码器的3个使能端都置为有效电平,保持正常工作;这里关键的就是处理3-8译码的8个输出端与全加器的2个输出的关系。

74ls138全加器电路图

  将3-8译码器的输出OUT(1、2、4、7)作为一个4输入的或门的输入,或门的输出作为加法器的和;将3-8译码器的输出OUT(3、5、6、7)作为一个4输入的或门的输入,或门的输出作为加法器的进位输出。当加法器的输入分别为:a=1,b=0,ci=1时,对应3-8译码器的输入为A=1,B=0,C=1,这是译码器对应的输出为OUT(5)=1,其余的为0,根据上面设计的连接关系,s=0,co=1,满足全加器的功能。


74ls138全减器电路图


74ls138全减器电路图


74ls138三人表决器电路图

74ls138三人表决器电路图

  三人表决器主要由一个3-8位译码器(74LS138)和2个4输入与非门(74LS20)组成。通过三个按钮接受用户输入。按钮按下表示同意,不按下表是否决,当没有人按下按钮时,或只有一个人按下按钮时,例如,S1按下,而S2和S0未按下,则红灯亮,绿灯灭,蜂鸣器无声音,表示否决,当有两个人及以上的人按下按钮后,例如,S1和S2按下,则红灯灭,绿灯亮,蜂鸣器发音,表示通过。运用74LS138译码器和四输入与非门74LS20实现该逻辑功能。


74ls138抢答器电路图

74ls138抢答器电路图


74ls138实现逻辑函数电路图

74ls138实现逻辑函数电路图

  F = ABC + A‘BC + AB’C

  = 111 + 110 + 101

  = Y7 + Y6 + Y5

  按照74LS138的规则,A 是低位(LSB),D 是高位(MSB)。

  74ls138 译码输出是低电平有效,用 74LS10 与非门,实际逻辑是输入低电平有效的或门。


译码器芯片74ls138的逻辑功能真值表


用与非门组成的3线-8线译码器74LS138

用与非门组成的3线-8线译码器74LS138


3线-8线译码器74LS138的功能真值表

3线-8线译码器74LS138的功能真值表


74ls138逻辑符号

74ls138逻辑符号

无论从逻辑图还是功能表我们都可以看到74LS138的八个输出引脚,任何时刻要么全为高电平1—芯片处于不工作状态,要么只有一个为低电平0,其余7个输出引脚全为高电平1。如果出现两个输出引脚同时为0的情况,说明该芯片已经损坏。


当附加控制门的输出为高电平(S=1)时,可由逻辑图写出

4.png

由上式可以看出,同时又是这三个变量的全部最小项的译码输出,所以也把这种译码器叫做最小项译码器。

71LS138有三个附加的控制端、和。当、时,输出为高电平(S=1),译码器处于工作状态。否则,译码器被禁止,所有的输出端被封锁在高电平,如表3.3.5所示。这三个控制端也叫做“片选”输入端,利用片选的作用可以将多篇连接起来以扩展译码器的功能。

带控制输入端的译码器又是一个完整的数据分配器。在图3.3.8电路中如果把作为“数据”输入端(同时),而将作为“地址”输入端,那么从送来的数据只能通过所指定的一根输出线送出去。这就不难理解为什么把叫做地址输入了。例如当=101时,门的输入端除了接至输出端的一个以外全是高电平,因此的数据以反码的形式从输出,而不会被送到其他任何一个输出端上。


71LS138的电气参数

71LS138的电气参数


71LS138的动态特性表

71LS138的动态特性表

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